三进制计数器状态转换图

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三进制可逆计数器原理

用两片四位二进制加法计数器 74LS161 组成三进制计数器，控制加 3 分的 计数脉冲，3 片十进制可逆计数器 74LS192 组成的加、减分计数器用于总分累加，最多 可计 999。译码器显示器用于显示分数。

进制。模同步计数器，模3就是就是3进制，模几就是几进制。三进制计数器就是以三进制为基础的实现计数运算的逻辑电路。

原理主要是由B通道输入频率为fB的经整形的信号控制闸门电路，即以一个脉冲开门，以随后的一个脉冲关门。两脉冲的时间间隔(TB)为开门时间。

图1是3位同步二进制加法计数器电路。该电路是由三个JK触发器接成T触发器的形式组成。同步二进制计数器是同步时序逻辑电路的一个实例，通过对该电路的分析，学会对此类电路的一般分析方法。

用jk触发器设计一个三进制计数器,怎么设计?

1、用jk触发器设计一个三进制计数器，计数是00，01，10，这三个数，所以，只需两个JK触发器就行，不需要3，用了3个，也有一个触发器的状态始终0，也没有用。

2、用JK触发器设计一个三进制计数器，计数为00，01，10三个状态的循环，所以需要用到两个JK触发器。先将2个JK触发器接成同步4进制加法计数器，再改成3进制加法器。

3、等于1时触发，后者主要在CP的前面触发（正跳0→1）。用JK触发器设计一个三进制计数器，计数为00，01，10三个状态的循环，所以需要用到两个JK触发器。先将2个JK触发器接成同步4进制加法计数器，再改成3进制加法器。

4、最后在每个时钟周期内，将计数器的进位设置为1，并将计数器的当前值加1，直到计数器的值为4为止， 将计数器的进位设置为0，并将计数器的当前值减1，直到计数器的值为0为止，将计数器的值转换为3进制即可。

三进制计数器有多少状态

当计数为3时，输出状态为11，利用11这个状态产生一个复位信号，使两个触发器复位回0，就不会出现计数的3了，最大数是2，即为要求的3进制计数器了。逻辑图（也即仿真图）如下，图中JK触发器是74LS112。

用JK触发器设计一个三进制计数器，计数为00，01，10三个状态的循环，所以需要用到两个JK触发器。先将2个JK触发器接成同步4进制加法计数器，再改成3进制加法器。

用jk触发器设计一个三进制计数器，计数是00，01，10，这三个数，所以，只需两个JK触发器就行，不需要3，用了3个，也有一个触发器的状态始终0，也没有用。

三进制是说计数器一个周期内有3个稳定的状态，不代表输出的数字必须是按顺序来的，输出数值只是一种编码方式，可以有很多种类的。

计数器可以用来显示产品的工作状态，一般来说主要是用来表示产品已经完成了多少份的折页配页工作。它主要的指标在于计数器的位数，常见的有3位和4位的。

这个图是几进制计数器,状态表都是啥,咋写?

先判断是同步计数器还是异步计数器：计数脉冲同时接到个触发器，各触发器状态的变换与计数脉冲同步即为同步计数器。根据电路图写出逻辑表达式，再化简。根据表达式写出逻辑状态表。最后根据逻辑状态表看是几进制计数器。

LD = 1010B = 10D ， LS161 是同步置数，计数至 10 时 CP 前沿已经过去，要在下一个 CP 完成置数，所以电路输出状态是 0 ~ 10 ， 共 11 种状态，是 11 进制计数器。

这个电路是六进制的计数器，当计数到0101(是五)时，与非门输出一个置数信号加到LD端，下一个脉冲到时，将0000送入计数器，实现回0，那么最大数是5，所以是六进制计数器。有效状态有：0000，0001，0010，0011，0100，0101。

进制是0~8，即0000~1000，只要在输出为1000时候，利用反馈清零，使计数器从0000开始重新计数。连接方式：EP＝ET＝＂1＂，CLK端－＂cp＂，D3D2D1D0端－＂0111＂，RD端－＂1＂，C端－非门－LD端。

是带异步清零功能的十六进制计数器。当检测与非门G输出为1时，电路处于计数状态；当G输出为0时，RD=0，此时74LS161处于异步清零状态，计数器Q3Q2Q1Q0输出0000。

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