脉冲转延时电平

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怎样将脉冲信号转成高低电平

1、用单稳态电路，用你的脉冲前沿，触发单稳电路，用RC设定单稳定时，时间稍大于你的脉冲周期，触发和连续触发，输出高电平，脉冲消失时间超过脉冲周期，单稳电路输出低电平。

2、就是脉冲电压的高低位置，高电压时叫高电平，脉冲下降到底时叫低电平。脉冲通常是指电子技术中经常运用的一种象脉搏似的短暂起伏的电冲击(电压或电流)。主要特性有波形、幅度、宽度和重复频率。

3、可以利用51单片机的计数器T0、T1，例如用计数器0的外部计数脉冲输入端T0计数，当计满100个脉冲数量后，触发中断。进入计数服务中断程序。

4、应该是pwm的极性问题，低电平翻转就是输出脉宽为低电平，高电平翻转则反之。

如何将一个高脉冲变成高电平/低电平

就是脉冲电压的高低位置，高电压时叫高电平，脉冲下降到底时叫低电平。脉冲通常是指电子技术中经常运用的一种象脉搏似的短暂起伏的电冲击(电压或电流)。主要特性有波形、幅度、宽度和重复频率。

V脉冲信号，就是高低电平。这个不涉及模数转换。这里，仅仅涉及电平转换，就是把5V开关信号转换为24V信号，建议使用光电耦合。

你必须要知道其频率（周期），用一只电容对其充电，串联1只二极管防止倒流，放电用1只电阻，R和C的时间常数只要大于1个周期且小于2个周期就行了。

用FPGA如何将脉冲信号转换成电平信号

当想要将输入的脉冲信号FLAGIN_CLK同步成B时钟域的一个电平信号，只需要在脉冲同步电路后再加上一个信号延长电路， 意思就是当FLAGOUT_CLKB为高时，输出一个高电平并用计数器计数，计数器的计数值就是高电平的时间。

我觉得，信号能够输入到FPGA，本身就是要求达到器件的setup\hold时间，如果可以达到，那FPGA内部处理实际上是可以使用异步FIFO来达到检测脉冲个数，然后只要使用时钟去读异步FIFO，就达到了将脉冲转换成时间周期输出的要求。

两种方法：一是：通过频压转换电路（自己百度），转换成0-10V左右的直流电平信号，然后进行A/D采样得到数字量，送给FPGA或者单片机。然后进行显示编码（由显示方式决定），然后控制显示单元显示频率。

如何将一脉冲信号转换为稳定高电平,用一般数字电路(急用)

方法是：先用单片机读取脉冲信号。然后，处理一下脉冲信号，得到计数值。最后，控制单片机内部自带的DA模块，将刚才处理后得到的数值以模拟量的形式发送出去。

信号线上串联一个数百pF的微分电容。在微分电容后面把2脚用一个电阻连到Vcc即可获得高电平。这个RC时间常数决定维持低电平的时间长度。

两种办法，1：外接频率/电压转换芯片，这时你只需要改变脉冲的频率通过专用芯片就可以转换为不同的电平值。2，直接FPGA给出脉宽调制信号，通过驱动电路后，不同的脉宽，可以等效为不同的电平值。

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