计数器clk,计数器clk和r

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如何用74LS161来实现7进制的计数器?

首先，找到一个74LS195芯片，将其J和K输入端子连接，将R和LOAD端子连接至高电平，将CP端子连接至脉冲信号，然后从左至右，从上至下将输出端子连接 底部数字为Q0，Q1，Q2，Q3，见下图。

LS161本身是十进制。要实现7进制有两种方法：清零和置数。清零法：将输出端的Q0、QQ2(Q3是高位)通过一个与非门接到清零端，置数端接高电平(数据输入端不用管)。

首先要知道74LS161是4位二进制同步计数器，该计数器能同步并行预置数据，具有清零置数，计数和保持功能，具有进位输出端，可以串接计数器使用。

同步计数器和异步计数器的区别

1、同步计数器和异步计数器的区别还是比较多的，首先在触发信号方面，同步计数器的触发信号是同一个信号，也就是说，同步计数器每一级的触发器接的都是同一个CLK信号，而异步计数器的触发信号时不同的。

2、操控不同：异步计数器是异步时序电路，其主要特点是内部各触发器的时钟脉冲端CP不全都连接在一起，因此各触发器的翻转时刻有先有后，其输出可能会产生干扰毛刺现象，但其电路结构简单。

3、区别：含义不同：同步计数器的触发信号是同一个信号。具体来说，每一级的触发器接的都是同一个CLK信号。异步计数器的触发信号时不同的，例如第一集的输出Q作为第二级的触发信号。

用74LS293构成的电路如图6-42所示,试分析其逻辑功能。

如果作以下变换：Y=AB+AC+BC，则可利用一个与或非门加一个非门实现，其逻辑电路图如图所示：组合逻辑电路的分析：根据给定的逻辑电路图，求出电路的逻辑功能。

）培养根据设计需要选学参考书籍，查阅相关手册、图表和文献资料的自学能力，并掌握抢答器的基本原理，掌握4D锁存器、计数器、555定时器的工作原理和使用方法。

用74 LS194构成8位移位寄存器 电路如图2所示，将芯片（1）的Q3）接至芯片（2）的SR，将芯片（2）的Q4接至芯片（1）的SL，即可构成8位的移位寄存器。

②仿真与实验电路图：仿真与实验电路图如图4所示。图4第9 页③实验结果：符合T′触发器的功能，发光二极管按时钟频率闪动，状态来回翻转。用双D触发器设计一个单发脉冲发生器。

逻辑表达式：Y＝DoA1’A0’＋D1A1’A0＋D2A1A0’＋D3A1A0 真值表：A1A0 Y 00 D0 01 D1 10 D2 11 D3 其功能为：四选一数据选择器，A1A0为地址。

用74LS161完成7进制的加法计数器(异步清零法)

HC161和74LS161都是常用的四位二进制可预置的同步加法计数器，74HC161是CMOS型，74LS161是TTL型。它可以灵活的运用在各种数字电路，以及单片机系统中实现分频器等很多重要的功能。

可以用同步4位二进制加法计数器74LS16三输入与非门74LS451共阴七段数码LED显示器来实现七进制的计数器。

首先，找到一个74LS195芯片，将其J和K输入端子连接，将R和LOAD端子连接至高电平，将CP端子连接至脉冲信号，然后从左至右，从上至下将输出端子连接 底部数字为Q0，Q1，Q2，Q3，见下图。

首先找到一块74LS195芯片，将其J、K输入端连接到一起，将R、LOAD端连接高电平，将CP端连接脉冲信号，再将输出端从左到右、从上到下编号为Q0、QQQ3，如图所示。

加法计数器的设计实验原理

LS161 是同步预置，异步清零，两种方法反馈数值差 1 ，清零法是计数到 24 去清零 。

若用上升沿触发的T′触发器同样可以组成异步二进制加法计数器，但每一级触发器的进位脉冲应改为Qˉ端输出。原因很简单，当低位触发器输出端Q端由1变为0时，Qˉ端的上升沿正好可以作为高位的触发脉冲。

要改成减法计数器，可将4个输出端各接一个非门，则原输出的状态取反后变成1111~0000，即F~0，就是减法计数了，逻辑图如下，也是仿真图。计数输出为0000，经4个非门取反后成为1111，十六进制数的F。

原理主要是由B通道输入频率为fB的经整形的信号控制闸门电路，即以一个脉冲开门，以随后的一个脉冲关门。两脉冲的时间间隔(TB)为开门时间。

门电路：门电路是由接口电路、逻辑门、时序电路和控制电路等组成的电路，可以实现逻辑运算和控制功能。

，可由十进制计数器采用一定的方法使它跳越3个无效状态0111~0110而实现六进制计数。置零信号取自0110即当状态0110（6出现时，将Q2=1，Q1=1送到清零端R即Rp= 0），使计数器立即清零， 状态0110仅瞬间存在。

74hc390分频原理

1、这种双单片电路有八个主从触发器和附加门，以构成两个独立的4位计数器，可以实现等于2分频、5分频乃至100分频的任何累加倍数的周期长度。

2、一般采用10进制计数器如74HC290、74HC390等来实现时间计数单元的计数功能。本次设计中选择74HC390。由其内部逻辑框图可知，其为双2-5-10异步计数器，并每一计数器均有一个异步清零端（高电平有效）。

3、利用1片74HC390实现12进制计数功能的电路如图3-6所示。另外，图3-6所示电路中，尚余－2进制计数单元，正好可作为分频器2HZ输出信号转化为1HZ信号之用。

4、数字N分频就是采用N进制计数器实现功能。74HC393是双十六进制计数器，其QA、QB、QC和QD端分别是八和十六进制计数输出端。因此，直接将QC端引出即能得到f(cp)的八分之一。

5、利用1片74HC390实现12进制计数功能的电路如图3-6所示。另外，图3-6所示电路中，尚余-2进制计数单元，正好可作为分频器2HZ输出信号转化为1HZ信号之用。

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