用74ls161设计147进制计数器「用74ls161和74ls47设计七进制计数器并显示」

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74hc161引脚图及功能

hc161有没有14引脚的hc161是直接清零的四位同步二进制计数器。采用双列直插16脚封装，8脚Gnd，16脚Ⅴcc，1脚清零，9脚置数，7脚p启动，10脚T启动，15脚行波进位输出。

RCO端是动态进位输出，REPPLE CARRY OUTPUT的简称。RCO端是15脚，此脚中文名叫动态进位输出。当时钟的上升沿使计数器输出为1111时，此脚此时由0变为1，接着的下一个时钟上升沿，使输出为0000，此脚此时也变为0。

从74LS161功能表功能表中可以知道，当清零端CR=“0”，计数器输出QQQQ0立即为全“0”，这个时候为异步复位功能。

hc161是直接清零的四位同步二进制计数器。采用双列直插16脚封装，8脚Gnd，16脚Ⅴcc，1脚清零，9脚置数，7脚p启动，10脚T启动，15脚行波进位输出。

急求!如何用74ls161和与非门设计四进制计数器。

设计四进制计数器，有两种方法：同步置数法或异步清零法。此处采用同步置数法。要使计数器为4进制，即循环0000~0011这4个状态。可使D0~D3接地，即预置数0000，将Q0和Q1接与非门输入端，与非门输出端接/LD。

如何用74ls161和与非门设计四进制计数器。用74HC161设计一个四进制计数器，使用同步置数功能。当计数到最大数3时，用一个与非门74LS00，产生一个置数信号加到置数端LD即可。

LS161是一个同步的可预置的四位二进制计数器，并自带有异步功能。可以采用反馈归零法进行6进制的计数器设计。

使用反馈预置法设计8进制计数器，8的二进制为1000，即Q2Q1Q0都为000，Q3为1，因此将Q3通过一个非门接入置位端，这样每次计数到7后被置为0，完成0-7的8进制计数。置数端D3D2D1D0设置为0。

74LS161的功能是什么?

1、要想实现就有两种方法，置零或置数，我用置零法来试试，因为74LS161是有异步置零端，所以需要到0111这个状态后再置零，因为0111这个状态时间很短所以不会进入有效状态。

2、LS161是四位二进制同步加法计数器，使用该计数器实现十二进制计数器主要有置数法和清零法两种方法。74ls161是四位二进 制计数器，本来一片就可以改成12进制计数器。

3、LS161是四位二进制同步加法计数器，使用该计数器实现十二进制计数器主要有置数法和清零法两种方法。

4、LS161是一种具有3个8位二进制计数器、3个基本RS触发器和1个时钟控制器的芯片。该芯片的引脚功能如下：CP0：时钟输入端，用于输入时钟信号。Q0～Q2：三个8位二进制计数器的输出端，用于控制三个基本RS触发器的状态。

5、使用反馈预置法设计8进制计数器，8的二进制为1000，即Q2Q1Q0都为000，Q3为1，因此将Q3通过一个非门接入置位端，这样每次计数到7后被置为0，完成0-7的8进制计数。置数端D3D2D1D0设置为0。

6、LS161是一种4位计数器。它有两个输入：一个是频率输入，另一个是复位输入。它有4个输出，这4个输出可以显示当前计数器的值。当频率输入为高电平时，计数器将按照频率输入计数。

如何用74LS161来实现7进制的计数器电路图?

首先找到一块74LS195芯片，将其J、K输入端连接到一起，将R、LOAD端连接高电平，将CP端连接脉冲信号，再将输出端从左到右、从上到下编号为Q0、QQQ3，如图所示。

LS161是4位2进制可预置同步计数器。要做7进制计数，最大值是6（0110），数据端置0，取161输出6取反，去控制置数端（9脚），161会等到下一个时钟脉冲才置入数据，完成溢出归零控制。

首先，找到一个74LS195芯片，将其J和K输入端子连接，将R和LOAD端子连接至高电平，将CP端子连接至脉冲信号，然后从左至右，从上至下将输出端子连接 底部数字为Q0，Q1，Q2，Q3，见下图。

HC161和74LS161都是常用的四位二进制可预置的同步加法计数器，74HC161是CMOS型，74LS161是TTL型。它可以灵活的运用在各种数字电路，以及单片机系统中实现分频器等很多重要的功能。

”、CP脉冲上升沿作用后，计数器加1。74LS161还有一个进位输出端CO，其逻辑关系是CO= Q0·Q1·Q2·Q3·CET。合理应用计数器的清零功能和置数功能，一片74LS161可以组成16进制以下的任意进制分频器。

利用74161构成七进制加法计数器，最大数是6，所以，利用计数到6时，产生置数脉冲，在下一个时钟脉冲时使计数器置数0000，实现回0。逻辑图如下，也是仿真图，图中的数码管你不用画，那是为了显示仿真效果的。

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