实验4计数器的设计（实验4计数器的设计实验报告）

鱼王 2023-11-15 23:00:37

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利用数电实验箱设计200加法计数器的原理

1、LS161 是同步预置，异步清零，两种方法反馈数值差 1 ，清零法是计数到 24 去清零。

2、计数器是实现计数运算的逻辑电路，计数器在数字系统中主要是对脉冲的个数进行计数，以实现测量、计数和控制的功能，同时兼有分频功能。希望可以帮到你。

3、原理概述：当 RST 清零端为 1 时，计数器清零。当 RST=1 时，计数器开始计数；当遇到 CLK 为上升沿时，并且当使能端 EN=1 时，计数器累加 1；当使能端 EN=0 时，计数器不加；当清零端为 1 时，计数器再次清零。

1、进制是0000~0110，4进制是0000~0011，才用74161和JK触发器充当开关，共用时钟，当J端子加高电平时，Q1端子输出高电平，Q2非为0，此时功能为7进制。当J端子变为0时，功能为4进制。

2、用160和与非门组成6进制加法计数器-用异步清零端设计电路如图2所示，给2管脚加矩形波，看数码管显示结果，并记录显示结果。用160和与非门组成7进制加法计数器-用同步置零设计则为七进制计数器。

3、可以用同步4位二进制加法计数器74LS16三输入与非门74LS451共阴七段数码LED显示器来实现七进制的计数器。

使用置数法实现74161的十进制计数：当74161计数到Q3Q2Q1Q0=1001时，使LD =0，为置数创造了条件。当下一个计数脉冲一到，各置数端数据立即送到输出端，预置数端D3D2D1D0= 0000。

可以采用反馈清0法，改成10进制计数器。利用计数器计数到10，即Q3Q2Q1Q0=1010时，产生一个复位信号，加到复位端CR上，使计数器立即回0，实现了改制。但是，1010的状态是看不到的，只是出现一瞬间。

这是一个十进制计数器。分析如下：由电路图可以看出，74LS161具有同步置数和计数两种功能。

③用硬件设计语言来实现。常见的数字设计语言为VHDL和Verilog 其中最快速有效的方法为利用现有的集成电路来搭建。最常见的计数器数字集成芯片为74LS160和74LS161。

是一个十六进制加法计数器。清零采用的是异步方式，置数采用的是同步方式。74161有数据置入功能。未计数前，将输出QD，QC，QB，QA，置成1000，然后开始计数，就能构成七进制计数器，计数到111时就有脉冲进位信号。

十进制整数转换为二进制整数十进制整数转换为二进制整数采用除2取余，逆序排列法。

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